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討論了 以數字信號處理器(DSP)和復雜可編程邏輯器件(CPLD)為核心的語音處理系統的設計,介紹了該系統的框圖和詳細的硬件設計方案.調試結果表明該系統工作穩定,性能良好,可用于語音信號編解碼和處理算法的設計與開發
語音處理是數字信號處理最活躍的研究方向之一，在IP電話和多媒體通信中得到廣泛應用。本文設計的語音處理系統采用通用數字信號處理器（DSP）和復雜可編程邏輯芯片（CPLD）實現，其中通用數字信號處理器具有實現簡便和程序可移植性強等優點，邏輯器件用于實現組合邏輯的時序控制.1系統組成
基于DSP和CPLD的語音處理平臺的組成及原理見圖1.如圖1所示，硬件部分包括語音采集與輸出模塊、程序數據存儲器FLASH模塊。數據存儲器SRAM模塊、系統時序邏輯控制CPLD模塊JTAG接口模塊以及電源模塊。語音處理DSP模塊，DSP處理器選用目前最通用的TI公司的TMS320VC5402 16 位處理器TMS320VC5402屬于第三代定點DSP處理器，是TI公司出品的TMS320VC54x家族中的杰出代表，由于CPU具有改進的哈佛結構、低功耗設計和高度并行的特點，使得本系列DSP芯片得以實現了低功耗、高性能，其結構非常適合于實時信號處理，主要應用于無線通信系統中.
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