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DRA71x 處理器采用 538 焊球、17mm × 17mm、0.65mm 焊球間距（0.8mm 間距規則可用于信號）球柵陣 列 (BGA) 封裝（采用了 Via Channel™ 陣列 (VCA) 技術）。 此架構旨在通過具有成本效益的解決方案，為汽車應用提供高性能并發性 ， 從而實現 DRA75x（“Jacinto 6 EP”和“Jacinto 6 Ex”）、DRA74x“Jacinto 6”和 DRA72x“Jacinto 6 Eco”信息娛樂處理器系列的全面可擴展 性，包括圖像、語音、HMI、多媒體和智能手機投影模式功能。 可編程性通過具有 Arm Neon™擴展的單核 Arm Cortex-A15 RISC CPU 和 TI C66x VLIW 浮點 DSP 內核實 現。借助 Arm 處理器，開發人員能夠將控制函數與在 DSP 和協處理器上編程的其他算法分離開來，從而降 低系統軟件的復雜性。 此外，TI 提供了一整套針對 Arm 和 DSP 的開發工具，其中包括 C 語言編譯器和一個可查看源代碼執行情 況的調試界面。
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