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電子發燒友網>電子資料下載>電子論文>模擬數字論文>如何使用Verilog HDL設計2位16進制的計數器詳細程序分析

如何使用Verilog HDL設計2位16進制的計數器詳細程序分析

2018-09-21 | rar | 0.05 MB | 次下載 | 免費

資料介紹

  實驗目的:

  學習計數器的設計、仿真和硬件測試方法。

  實驗內容及步驟:

  1.使用Verilog HDL設計2位 16進制計數器,由DE2的KEY0輸入計數值,在HEX1,HEX0上顯示計數值。

  2.使用嵌入式邏輯分析儀進行仿真;

  3.將實驗程序下載到DE2運行。

  實驗注意事項:去抖動

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